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// NOTE: Assertions have been autogenerated by utils/update_cc_test_checks.py
// RUN: %clang -x c++ -std=c++11 -S -O2 -msse4.2 -o - %s | FileCheck -check-prefix=CHECK-SSE42 %s
// RUN: %clang -x c++ -std=c++11 -S -O2 -mavx2 -o - %s | FileCheck -check-prefix=CHECK-AVX2 %s
// RUN: %clang -x c++ -std=c++11 -S -O2 -DTEST_SIMD128 -mavx2 -o - %s | FileCheck -check-prefix=CHECK-AVX2-128 %s
#include "dimsum.h"
using namespace dimsum;
#if defined(TEST_SIMD128)
template <typename T>
using TestedSimd = Simd128<T>;
#else
template <typename T>
using TestedSimd = NativeSimd<T>;
#endif
// The extern "C" functions below doesn't create instantiations of Simd<>.
// Create them here to suppress compiler warnings about returning incomplete
// type.
TestedSimd<int8> simd_a0;
TestedSimd<int16> simd_a2;
TestedSimd<int32> simd_a3;
TestedSimd<int64> simd_a4;
TestedSimd<uint8> simd_a5;
TestedSimd<uint16> simd_a6;
TestedSimd<uint32> simd_a7;
TestedSimd<uint64> simd_a8;
TestedSimd<float> simd_a9;
TestedSimd<double> simd_a10;
extern "C" {
// CHECK-SSE42-LABEL: operatorADD_0:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: paddb %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorADD_0:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpaddb %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorADD_0:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpaddb %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int8> operatorADD_0(TestedSimd<int8> a, TestedSimd<int8> b) {
return a + b;
}
// CHECK-SSE42-LABEL: operatorADD_1:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: paddw %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorADD_1:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpaddw %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorADD_1:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpaddw %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int16> operatorADD_1(TestedSimd<int16> a, TestedSimd<int16> b) {
return a + b;
}
// CHECK-SSE42-LABEL: operatorADD_2:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: paddd %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorADD_2:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpaddd %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorADD_2:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpaddd %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int32> operatorADD_2(TestedSimd<int32> a, TestedSimd<int32> b) {
return a + b;
}
// CHECK-SSE42-LABEL: operatorADD_3:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: paddq %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorADD_3:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpaddq %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorADD_3:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpaddq %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int64> operatorADD_3(TestedSimd<int64> a, TestedSimd<int64> b) {
return a + b;
}
// CHECK-SSE42-LABEL: operatorADD_4:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: paddb %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorADD_4:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpaddb %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorADD_4:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpaddb %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint8> operatorADD_4(TestedSimd<uint8> a, TestedSimd<uint8> b) {
return a + b;
}
// CHECK-SSE42-LABEL: operatorADD_5:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: paddw %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorADD_5:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpaddw %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorADD_5:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpaddw %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint16> operatorADD_5(TestedSimd<uint16> a, TestedSimd<uint16> b) {
return a + b;
}
// CHECK-SSE42-LABEL: operatorADD_6:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: paddd %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorADD_6:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpaddd %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorADD_6:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpaddd %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint32> operatorADD_6(TestedSimd<uint32> a, TestedSimd<uint32> b) {
return a + b;
}
// CHECK-SSE42-LABEL: operatorADD_7:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: paddq %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorADD_7:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpaddq %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorADD_7:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpaddq %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint64> operatorADD_7(TestedSimd<uint64> a, TestedSimd<uint64> b) {
return a + b;
}
// CHECK-SSE42-LABEL: operatorADD_8:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: addps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorADD_8:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vaddps %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorADD_8:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vaddps %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<float> operatorADD_8(TestedSimd<float> a, TestedSimd<float> b) {
return a + b;
}
// CHECK-SSE42-LABEL: operatorADD_9:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: addpd %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorADD_9:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vaddpd %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorADD_9:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vaddpd %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<double> operatorADD_9(TestedSimd<double> a, TestedSimd<double> b) {
return a + b;
}
// CHECK-SSE42-LABEL: operatorSUB_0:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: psubb %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorSUB_0:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpsubb %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorSUB_0:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpsubb %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int8> operatorSUB_0(TestedSimd<int8> a, TestedSimd<int8> b) {
return a - b;
}
// CHECK-SSE42-LABEL: operatorSUB_1:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: psubw %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorSUB_1:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpsubw %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorSUB_1:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpsubw %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int16> operatorSUB_1(TestedSimd<int16> a, TestedSimd<int16> b) {
return a - b;
}
// CHECK-SSE42-LABEL: operatorSUB_2:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: psubd %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorSUB_2:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpsubd %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorSUB_2:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpsubd %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int32> operatorSUB_2(TestedSimd<int32> a, TestedSimd<int32> b) {
return a - b;
}
// CHECK-SSE42-LABEL: operatorSUB_3:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: psubq %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorSUB_3:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpsubq %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorSUB_3:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpsubq %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int64> operatorSUB_3(TestedSimd<int64> a, TestedSimd<int64> b) {
return a - b;
}
// CHECK-SSE42-LABEL: operatorSUB_4:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: psubb %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorSUB_4:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpsubb %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorSUB_4:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpsubb %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint8> operatorSUB_4(TestedSimd<uint8> a, TestedSimd<uint8> b) {
return a - b;
}
// CHECK-SSE42-LABEL: operatorSUB_5:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: psubw %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorSUB_5:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpsubw %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorSUB_5:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpsubw %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint16> operatorSUB_5(TestedSimd<uint16> a, TestedSimd<uint16> b) {
return a - b;
}
// CHECK-SSE42-LABEL: operatorSUB_6:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: psubd %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorSUB_6:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpsubd %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorSUB_6:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpsubd %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint32> operatorSUB_6(TestedSimd<uint32> a, TestedSimd<uint32> b) {
return a - b;
}
// CHECK-SSE42-LABEL: operatorSUB_7:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: psubq %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorSUB_7:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpsubq %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorSUB_7:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpsubq %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint64> operatorSUB_7(TestedSimd<uint64> a, TestedSimd<uint64> b) {
return a - b;
}
// CHECK-SSE42-LABEL: operatorSUB_8:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: subps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorSUB_8:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vsubps %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorSUB_8:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vsubps %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<float> operatorSUB_8(TestedSimd<float> a, TestedSimd<float> b) {
return a - b;
}
// CHECK-SSE42-LABEL: operatorSUB_9:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: subpd %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorSUB_9:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vsubpd %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorSUB_9:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vsubpd %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<double> operatorSUB_9(TestedSimd<double> a, TestedSimd<double> b) {
return a - b;
}
// CHECK-SSE42-LABEL: operatorMUL_0:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: pmovzxbw {{.*#+}} xmm3 = xmm0[0],zero,xmm0[1],zero,xmm0[2],zero,xmm0[3],zero,xmm0[4],zero,xmm0[5],zero,xmm0[6],zero,xmm0[7],zero
// CHECK-SSE42-NEXT: punpckhbw {{.*#+}} xmm0 = xmm0[8,8,9,9,10,10,11,11,12,12,13,13,14,14,15,15]
// CHECK-SSE42-NEXT: pmovzxbw {{.*#+}} xmm2 = xmm1[0],zero,xmm1[1],zero,xmm1[2],zero,xmm1[3],zero,xmm1[4],zero,xmm1[5],zero,xmm1[6],zero,xmm1[7],zero
// CHECK-SSE42-NEXT: punpckhbw {{.*#+}} xmm1 = xmm1[8,8,9,9,10,10,11,11,12,12,13,13,14,14,15,15]
// CHECK-SSE42-NEXT: pmullw %xmm0, %xmm1
// CHECK-SSE42-NEXT: movdqa {{.*#+}} xmm0 = [255,255,255,255,255,255,255,255]
// CHECK-SSE42-NEXT: pand %xmm0, %xmm1
// CHECK-SSE42-NEXT: pmullw %xmm3, %xmm2
// CHECK-SSE42-NEXT: pand %xmm0, %xmm2
// CHECK-SSE42-NEXT: packuswb %xmm1, %xmm2
// CHECK-SSE42-NEXT: movdqa %xmm2, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorMUL_0:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vextracti128 $1, %ymm0, %xmm2
// CHECK-AVX2-NEXT: vpmovsxbw %xmm2, %ymm2
// CHECK-AVX2-NEXT: vextracti128 $1, %ymm1, %xmm3
// CHECK-AVX2-NEXT: vpmovsxbw %xmm3, %ymm3
// CHECK-AVX2-NEXT: vpmullw %ymm2, %ymm3, %ymm2
// CHECK-AVX2-NEXT: vextracti128 $1, %ymm2, %xmm3
// CHECK-AVX2-NEXT: vmovdqa {{.*#+}} xmm4 = <0,2,4,6,8,10,12,14,u,u,u,u,u,u,u,u>
// CHECK-AVX2-NEXT: vpshufb %xmm4, %xmm3, %xmm3
// CHECK-AVX2-NEXT: vpshufb %xmm4, %xmm2, %xmm2
// CHECK-AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm2 = xmm2[0],xmm3[0]
// CHECK-AVX2-NEXT: vpmovsxbw %xmm0, %ymm0
// CHECK-AVX2-NEXT: vpmovsxbw %xmm1, %ymm1
// CHECK-AVX2-NEXT: vpmullw %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: vextracti128 $1, %ymm0, %xmm1
// CHECK-AVX2-NEXT: vpshufb %xmm4, %xmm1, %xmm1
// CHECK-AVX2-NEXT: vpshufb %xmm4, %xmm0, %xmm0
// CHECK-AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm1[0]
// CHECK-AVX2-NEXT: vinserti128 $1, %xmm2, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorMUL_0:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpmovsxbw %xmm0, %ymm0
// CHECK-AVX2-128-NEXT: vpmovsxbw %xmm1, %ymm1
// CHECK-AVX2-128-NEXT: vpmullw %ymm0, %ymm1, %ymm0
// CHECK-AVX2-128-NEXT: vextracti128 $1, %ymm0, %xmm1
// CHECK-AVX2-128-NEXT: vmovdqa {{.*#+}} xmm2 = <0,2,4,6,8,10,12,14,u,u,u,u,u,u,u,u>
// CHECK-AVX2-128-NEXT: vpshufb %xmm2, %xmm1, %xmm1
// CHECK-AVX2-128-NEXT: vpshufb %xmm2, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm1[0]
// CHECK-AVX2-128-NEXT: vzeroupper
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int8> operatorMUL_0(TestedSimd<int8> a, TestedSimd<int8> b) {
return a * b;
}
// CHECK-SSE42-LABEL: operatorMUL_1:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: pmullw %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorMUL_1:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpmullw %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorMUL_1:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpmullw %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int16> operatorMUL_1(TestedSimd<int16> a, TestedSimd<int16> b) {
return a * b;
}
// CHECK-SSE42-LABEL: operatorMUL_2:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: pmulld %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorMUL_2:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpmulld %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorMUL_2:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpmulld %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int32> operatorMUL_2(TestedSimd<int32> a, TestedSimd<int32> b) {
return a * b;
}
// CHECK-SSE42-LABEL: operatorMUL_3:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: movdqa %xmm1, %xmm2
// CHECK-SSE42-NEXT: psrlq $32, %xmm2
// CHECK-SSE42-NEXT: pmuludq %xmm0, %xmm2
// CHECK-SSE42-NEXT: movdqa %xmm0, %xmm3
// CHECK-SSE42-NEXT: psrlq $32, %xmm3
// CHECK-SSE42-NEXT: pmuludq %xmm1, %xmm3
// CHECK-SSE42-NEXT: paddq %xmm2, %xmm3
// CHECK-SSE42-NEXT: psllq $32, %xmm3
// CHECK-SSE42-NEXT: pmuludq %xmm1, %xmm0
// CHECK-SSE42-NEXT: paddq %xmm3, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorMUL_3:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpsrlq $32, %ymm1, %ymm2
// CHECK-AVX2-NEXT: vpmuludq %ymm0, %ymm2, %ymm2
// CHECK-AVX2-NEXT: vpsrlq $32, %ymm0, %ymm3
// CHECK-AVX2-NEXT: vpmuludq %ymm3, %ymm1, %ymm3
// CHECK-AVX2-NEXT: vpaddq %ymm2, %ymm3, %ymm2
// CHECK-AVX2-NEXT: vpsllq $32, %ymm2, %ymm2
// CHECK-AVX2-NEXT: vpmuludq %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: vpaddq %ymm2, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorMUL_3:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpsrlq $32, %xmm1, %xmm2
// CHECK-AVX2-128-NEXT: vpmuludq %xmm0, %xmm2, %xmm2
// CHECK-AVX2-128-NEXT: vpsrlq $32, %xmm0, %xmm3
// CHECK-AVX2-128-NEXT: vpmuludq %xmm3, %xmm1, %xmm3
// CHECK-AVX2-128-NEXT: vpaddq %xmm2, %xmm3, %xmm2
// CHECK-AVX2-128-NEXT: vpsllq $32, %xmm2, %xmm2
// CHECK-AVX2-128-NEXT: vpmuludq %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: vpaddq %xmm2, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int64> operatorMUL_3(TestedSimd<int64> a, TestedSimd<int64> b) {
return a * b;
}
// CHECK-SSE42-LABEL: operatorMUL_4:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: pmovzxbw {{.*#+}} xmm3 = xmm0[0],zero,xmm0[1],zero,xmm0[2],zero,xmm0[3],zero,xmm0[4],zero,xmm0[5],zero,xmm0[6],zero,xmm0[7],zero
// CHECK-SSE42-NEXT: punpckhbw {{.*#+}} xmm0 = xmm0[8,8,9,9,10,10,11,11,12,12,13,13,14,14,15,15]
// CHECK-SSE42-NEXT: pmovzxbw {{.*#+}} xmm2 = xmm1[0],zero,xmm1[1],zero,xmm1[2],zero,xmm1[3],zero,xmm1[4],zero,xmm1[5],zero,xmm1[6],zero,xmm1[7],zero
// CHECK-SSE42-NEXT: punpckhbw {{.*#+}} xmm1 = xmm1[8,8,9,9,10,10,11,11,12,12,13,13,14,14,15,15]
// CHECK-SSE42-NEXT: pmullw %xmm0, %xmm1
// CHECK-SSE42-NEXT: movdqa {{.*#+}} xmm0 = [255,255,255,255,255,255,255,255]
// CHECK-SSE42-NEXT: pand %xmm0, %xmm1
// CHECK-SSE42-NEXT: pmullw %xmm3, %xmm2
// CHECK-SSE42-NEXT: pand %xmm0, %xmm2
// CHECK-SSE42-NEXT: packuswb %xmm1, %xmm2
// CHECK-SSE42-NEXT: movdqa %xmm2, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorMUL_4:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vextracti128 $1, %ymm0, %xmm2
// CHECK-AVX2-NEXT: vpmovsxbw %xmm2, %ymm2
// CHECK-AVX2-NEXT: vextracti128 $1, %ymm1, %xmm3
// CHECK-AVX2-NEXT: vpmovsxbw %xmm3, %ymm3
// CHECK-AVX2-NEXT: vpmullw %ymm2, %ymm3, %ymm2
// CHECK-AVX2-NEXT: vextracti128 $1, %ymm2, %xmm3
// CHECK-AVX2-NEXT: vmovdqa {{.*#+}} xmm4 = <0,2,4,6,8,10,12,14,u,u,u,u,u,u,u,u>
// CHECK-AVX2-NEXT: vpshufb %xmm4, %xmm3, %xmm3
// CHECK-AVX2-NEXT: vpshufb %xmm4, %xmm2, %xmm2
// CHECK-AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm2 = xmm2[0],xmm3[0]
// CHECK-AVX2-NEXT: vpmovsxbw %xmm0, %ymm0
// CHECK-AVX2-NEXT: vpmovsxbw %xmm1, %ymm1
// CHECK-AVX2-NEXT: vpmullw %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: vextracti128 $1, %ymm0, %xmm1
// CHECK-AVX2-NEXT: vpshufb %xmm4, %xmm1, %xmm1
// CHECK-AVX2-NEXT: vpshufb %xmm4, %xmm0, %xmm0
// CHECK-AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm1[0]
// CHECK-AVX2-NEXT: vinserti128 $1, %xmm2, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorMUL_4:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpmovsxbw %xmm0, %ymm0
// CHECK-AVX2-128-NEXT: vpmovsxbw %xmm1, %ymm1
// CHECK-AVX2-128-NEXT: vpmullw %ymm0, %ymm1, %ymm0
// CHECK-AVX2-128-NEXT: vextracti128 $1, %ymm0, %xmm1
// CHECK-AVX2-128-NEXT: vmovdqa {{.*#+}} xmm2 = <0,2,4,6,8,10,12,14,u,u,u,u,u,u,u,u>
// CHECK-AVX2-128-NEXT: vpshufb %xmm2, %xmm1, %xmm1
// CHECK-AVX2-128-NEXT: vpshufb %xmm2, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm1[0]
// CHECK-AVX2-128-NEXT: vzeroupper
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint8> operatorMUL_4(TestedSimd<uint8> a, TestedSimd<uint8> b) {
return a * b;
}
// CHECK-SSE42-LABEL: operatorMUL_5:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: pmullw %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorMUL_5:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpmullw %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorMUL_5:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpmullw %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint16> operatorMUL_5(TestedSimd<uint16> a, TestedSimd<uint16> b) {
return a * b;
}
// CHECK-SSE42-LABEL: operatorMUL_6:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: pmulld %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorMUL_6:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpmulld %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorMUL_6:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpmulld %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint32> operatorMUL_6(TestedSimd<uint32> a, TestedSimd<uint32> b) {
return a * b;
}
// CHECK-SSE42-LABEL: operatorMUL_7:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: movdqa %xmm1, %xmm2
// CHECK-SSE42-NEXT: psrlq $32, %xmm2
// CHECK-SSE42-NEXT: pmuludq %xmm0, %xmm2
// CHECK-SSE42-NEXT: movdqa %xmm0, %xmm3
// CHECK-SSE42-NEXT: psrlq $32, %xmm3
// CHECK-SSE42-NEXT: pmuludq %xmm1, %xmm3
// CHECK-SSE42-NEXT: paddq %xmm2, %xmm3
// CHECK-SSE42-NEXT: psllq $32, %xmm3
// CHECK-SSE42-NEXT: pmuludq %xmm1, %xmm0
// CHECK-SSE42-NEXT: paddq %xmm3, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorMUL_7:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vpsrlq $32, %ymm1, %ymm2
// CHECK-AVX2-NEXT: vpmuludq %ymm0, %ymm2, %ymm2
// CHECK-AVX2-NEXT: vpsrlq $32, %ymm0, %ymm3
// CHECK-AVX2-NEXT: vpmuludq %ymm3, %ymm1, %ymm3
// CHECK-AVX2-NEXT: vpaddq %ymm2, %ymm3, %ymm2
// CHECK-AVX2-NEXT: vpsllq $32, %ymm2, %ymm2
// CHECK-AVX2-NEXT: vpmuludq %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: vpaddq %ymm2, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorMUL_7:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vpsrlq $32, %xmm1, %xmm2
// CHECK-AVX2-128-NEXT: vpmuludq %xmm0, %xmm2, %xmm2
// CHECK-AVX2-128-NEXT: vpsrlq $32, %xmm0, %xmm3
// CHECK-AVX2-128-NEXT: vpmuludq %xmm3, %xmm1, %xmm3
// CHECK-AVX2-128-NEXT: vpaddq %xmm2, %xmm3, %xmm2
// CHECK-AVX2-128-NEXT: vpsllq $32, %xmm2, %xmm2
// CHECK-AVX2-128-NEXT: vpmuludq %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: vpaddq %xmm2, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint64> operatorMUL_7(TestedSimd<uint64> a, TestedSimd<uint64> b) {
return a * b;
}
// CHECK-SSE42-LABEL: operatorMUL_8:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: mulps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorMUL_8:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vmulps %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorMUL_8:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vmulps %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<float> operatorMUL_8(TestedSimd<float> a, TestedSimd<float> b) {
return a * b;
}
// CHECK-SSE42-LABEL: operatorMUL_9:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: mulpd %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorMUL_9:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vmulpd %ymm1, %ymm0, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorMUL_9:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vmulpd %xmm1, %xmm0, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<double> operatorMUL_9(TestedSimd<double> a, TestedSimd<double> b) {
return a * b;
}
// CHECK-SSE42-LABEL: operatorAND_0:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: andps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorAND_0:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vandps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorAND_0:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vandps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int8> operatorAND_0(TestedSimd<int8> a, TestedSimd<int8> b) {
return a & b;
}
// CHECK-SSE42-LABEL: operatorAND_1:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: andps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorAND_1:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vandps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorAND_1:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vandps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int16> operatorAND_1(TestedSimd<int16> a, TestedSimd<int16> b) {
return a & b;
}
// CHECK-SSE42-LABEL: operatorAND_2:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: andps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorAND_2:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vandps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorAND_2:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vandps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int32> operatorAND_2(TestedSimd<int32> a, TestedSimd<int32> b) {
return a & b;
}
// CHECK-SSE42-LABEL: operatorAND_3:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: andps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorAND_3:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vandps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorAND_3:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vandps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int64> operatorAND_3(TestedSimd<int64> a, TestedSimd<int64> b) {
return a & b;
}
// CHECK-SSE42-LABEL: operatorAND_4:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: andps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorAND_4:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vandps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorAND_4:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vandps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint8> operatorAND_4(TestedSimd<uint8> a, TestedSimd<uint8> b) {
return a & b;
}
// CHECK-SSE42-LABEL: operatorAND_5:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: andps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorAND_5:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vandps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorAND_5:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vandps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint16> operatorAND_5(TestedSimd<uint16> a, TestedSimd<uint16> b) {
return a & b;
}
// CHECK-SSE42-LABEL: operatorAND_6:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: andps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorAND_6:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vandps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorAND_6:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vandps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint32> operatorAND_6(TestedSimd<uint32> a, TestedSimd<uint32> b) {
return a & b;
}
// CHECK-SSE42-LABEL: operatorAND_7:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: andps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorAND_7:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vandps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorAND_7:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vandps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint64> operatorAND_7(TestedSimd<uint64> a, TestedSimd<uint64> b) {
return a & b;
}
// CHECK-SSE42-LABEL: operatorXOR_0:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: xorps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorXOR_0:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vxorps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorXOR_0:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vxorps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int8> operatorXOR_0(TestedSimd<int8> a, TestedSimd<int8> b) {
return a ^ b;
}
// CHECK-SSE42-LABEL: operatorXOR_1:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: xorps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorXOR_1:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vxorps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorXOR_1:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vxorps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int16> operatorXOR_1(TestedSimd<int16> a, TestedSimd<int16> b) {
return a ^ b;
}
// CHECK-SSE42-LABEL: operatorXOR_2:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: xorps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorXOR_2:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vxorps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorXOR_2:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vxorps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int32> operatorXOR_2(TestedSimd<int32> a, TestedSimd<int32> b) {
return a ^ b;
}
// CHECK-SSE42-LABEL: operatorXOR_3:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: xorps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorXOR_3:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vxorps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorXOR_3:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vxorps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int64> operatorXOR_3(TestedSimd<int64> a, TestedSimd<int64> b) {
return a ^ b;
}
// CHECK-SSE42-LABEL: operatorXOR_4:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: xorps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorXOR_4:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vxorps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorXOR_4:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vxorps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint8> operatorXOR_4(TestedSimd<uint8> a, TestedSimd<uint8> b) {
return a ^ b;
}
// CHECK-SSE42-LABEL: operatorXOR_5:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: xorps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorXOR_5:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vxorps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorXOR_5:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vxorps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint16> operatorXOR_5(TestedSimd<uint16> a, TestedSimd<uint16> b) {
return a ^ b;
}
// CHECK-SSE42-LABEL: operatorXOR_6:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: xorps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorXOR_6:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vxorps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorXOR_6:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vxorps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint32> operatorXOR_6(TestedSimd<uint32> a, TestedSimd<uint32> b) {
return a ^ b;
}
// CHECK-SSE42-LABEL: operatorXOR_7:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: xorps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorXOR_7:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vxorps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorXOR_7:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vxorps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<uint64> operatorXOR_7(TestedSimd<uint64> a, TestedSimd<uint64> b) {
return a ^ b;
}
// CHECK-SSE42-LABEL: operatorOR_0:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: orps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorOR_0:
// CHECK-AVX2: # %bb.0:
// CHECK-AVX2-NEXT: vorps %ymm0, %ymm1, %ymm0
// CHECK-AVX2-NEXT: retq
//
// CHECK-AVX2-128-LABEL: operatorOR_0:
// CHECK-AVX2-128: # %bb.0:
// CHECK-AVX2-128-NEXT: vorps %xmm0, %xmm1, %xmm0
// CHECK-AVX2-128-NEXT: retq
TestedSimd<int8> operatorOR_0(TestedSimd<int8> a, TestedSimd<int8> b) {
return a | b;
}
// CHECK-SSE42-LABEL: operatorOR_1:
// CHECK-SSE42: # %bb.0:
// CHECK-SSE42-NEXT: orps %xmm1, %xmm0
// CHECK-SSE42-NEXT: retq
//
// CHECK-AVX2-LABEL: operatorOR_1: